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利用硬件描述语言结合可编程逻辑器件(PLD)可以极大地方便数字集成电路的设计，本文介绍一种利用VHDL．硬件描述语言结合现场可编程门阵列（FPGA)设计的数控延时器，延时器在时钟clk的作用下，从8位数据线输入延时量，到IATCH高电平时锁存数据，可以实现对触发脉冲TRIG的任意量的延时。由于延时范围不同，设计所用到的FPGA的资源也不同，本文详细介绍最大延时量小于触发脉冲周期的情况。该延时器的软件编程和调试均在Muxplus II环境下完成，系统设计选用Altera公司的EPFl0K30AQC208-3，EPC1441型专用电路，与DSP相结合，应用于雷达目标模拟器的控制部分，实现对目标距离的模拟。，大小：485 KB
利用硬件描述语言结合可编程逻辑器件(PLD)可以极大地方便数字集成电路的设计，本文介绍一种利用VHDL．硬件描述语言结合现场可编程门阵列（FPGA)设计的数控延时器，延时器在时钟clk的作用下，从8位数据线输入延时量，到IATCH高电平时锁存数据，可以实现对触发脉冲TRIG的任意量的延时。由于延时范围不同，设计所用到的FPGA的资源也不同，本文详细介绍最大延时量小于触发脉冲周期的情况。该延时器的软件编程和调试均在Muxplus II环境下完成，系统设计选用Altera公司的EPFl0K30AQC208-3，EPC1441型专用电路，与DSP相结合，应用于雷达目标模拟器的控制部分，实现对目标距离的模拟。，大小：485 KB